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首页 - 产品中心 - 铜互连产品 - LVDS缓冲器

PHD25BR120

带输出预加重的3.125Gb/s LVDS缓冲器

PHD25BR120用户手册
产品详情 技术文档 设计和开发

产品详情

参数 封装 | 引脚 | 尺寸 特性 说明
FunctionBuffer
ProtocolsLVDS
Number of transmitters1
Number of receivers1
Supply voltage (V)3.3
Signaling rate (Mbps)3125
Input signalCML, LVCMOS, LVDS, LVPECL
Output signalLVDS
RatingCatalog
Operating temperature range (°C)-40 to 85


image.png

传输速率可达 3.125 Gbps,低抖动,低噪声,低功耗

四级输出预加重驱动补偿背板和线缆损耗

片上 100Ω输入输出端接,最小化插入损耗和回波损耗,降低器件成本,最小化板级布局空间

IO 引脚上 8kV ESD 能力保护相邻器件

3mm×3mm DFN10 小型化封装

        PHD25BR120 是一款单通道 3.125 Gbps LVDS 缓冲器。对于在 FR-4 PCB 背板和平衡金属电缆上传输的高速信号可进行针对性优化。全差分信号路径可保证出色的信号完整性和抗噪性。

        PHD25BR120 具有四级预加重(PE),用于优化发射机驱动能力。其它具备相同 IO 特性的 LVDS 产品分别包含以下特性:PHD25BR110 具有四级均衡功能,可用于优化接收机均衡能力; PHD25BR100 具有接收均衡和输出预加重功能,可用于优化系统中继能力。 PHD25BR150 是一款具有最低功耗的缓冲器/中继器,不具有输出预加重或者接收均衡功能。

        宽输入动态范围保证了本产品的输入端可接收 LVDS, CML 和 LVPECL 信号;而输出电平为 LVDS 信号。最小化的封装和直通式引脚保证了板级布局的空间最小化和简单设计性。差分输入和输出通过 100Ω 电阻在内部端接,以降低器件输入和输出回波损耗、减少元件数量并进一步最小化电路板空间。


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数据表 PHD25BR120用户手册

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